逻辑信号分析的总体结构如图1所示；其中逻辑分析仪由8路逻辑信号检测电路、单片机系统和CPLD点阵扫描控制电路构成。逻辑分析仪能接受8路逻辑信号(D7~D0)和位传送时钟信号(B-CLK)；其接受的逻辑信号形式如图2所示。

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逻辑分析仪各部分解释如下：

2.1  逻辑信号检测

8路逻辑信号检测部分由8选1采样模拟开关（CD4051）和模数转换器ADC（MAX7820）组成，如图3所示。为了适应较宽范围（0.25~4V）逻辑信号门限电压（逻辑1的电压）的输入，对逻辑信号电平采用模拟信号采样，当AD转换获得逻辑信号电平的数字量（A/D-DATA）大于门限电压对应的数字量时，确定为逻辑1。由于分时检测8路逻辑信号（D7~D0），要求采样开关速度和AD转换速度要远远大于逻辑信号位传送速度；当位传送时钟信号到来时，才能保证8路逻辑信号每1路采样点在靠近位的中间位置，从而得到可靠的电平数字量。

本设计的CD4051从地址选通（CH-SELECT）到数据输出时间约500ns，MAX7820转换一路信号所需的时间约3ns，采集处理8路逻辑信号各位（1个字节）所需时间约5us。若8路逻辑信号每位采样点在位中间的三分之一区，则逻辑信号的位宽约为15us，因此本设计的逻辑分析仪可对66kHz以下波特率的8路信号进行逻辑分析。

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2.3